模擬集成電路課程設計
A. 50 分!!!急求第八章模擬CMOS集成電路設計-拉扎維(課件)
告訴我你郵箱我發給你
B. 高分求課程設計:利用D/A晶元實現電機轉速控制
電機變速一般都是直流電機,所以電壓是改變電機速度的辦法,只能一步一步的實驗才行,僅僅靠理論是不行的
C. 大學數字電子技術的課程設計:數字式電子鍾的設計或交通燈控制電路設計
設計題目:
數字鍾的設計與模擬
二.設計要求:
(1)設計一個有「時」、「分」、「秒」(12小時59分59秒)顯示,且有校時功能的電子鍾;
(2)顯示採用六隻LED數碼管分別顯示時分秒;
(3)時間的小時、分可手動調整;
(4)採用+5V電源供電。
三.題目分析:
根據題目,我們可以分析出:數字電子鍾是由多塊數字集成電路構成的,其中有振盪器,分頻器,校時電路,計數器,解碼器和顯示器六部分組成。振盪器和分頻器組成標准秒信號發生器,不同進制的計數器產生計數,解碼器和顯示器進行顯示,通過校時電路實現對時,分的校準。
1)振盪器又包括由集成電路555與RC組成的多諧振盪器,用石英晶體構成的振盪器和由邏輯門與RC組成的時鍾源振盪器。三種方案如下圖所示:
方案一:由集成電路定時器555與RC組成的多諧振盪器作為時間標准信號源。
555與RC組成的多諧振盪器圖
方案二:振盪器是數字鍾的核心。振盪器的穩定度及頻率的精確度決定了數字鍾計時的准確程度,通常選用石英晶體構成振盪器電路。石英晶體振盪器的作用是產生時間標准信號。因此,一般採用石英晶體振盪器經過分頻得到這一時間脈沖信號。
石英晶體振盪器圖
方案三:由集成邏輯門與RC組成的時鍾源振盪器。
門電路組成的多諧振盪器圖
集成電路555與RC組成的多諧振盪器電路:如果精度要求不高,則可以採用由集成電路定時器555與RC組成的多諧振盪器。如上圖所示。設振盪頻率f=1KHz,R為可調電阻,微調R1可以調出1KHz輸出。
石英晶體振盪電路:採用的32768晶體振盪電路,其頻率為32768Hz,然後再經過15分頻電路可得到標準的1Hz的脈沖輸出.R的阻值,對於TTL門電路通常在0.7~2KΩ之間;對於CMOS門則常在10~100MΩ之間。
由門電路組成的多諧振盪器的振盪周期不僅與時間常數RC有關,而且還取決於門電路的閾值電壓VTH,由於VTH容易受到溫度、電源電壓及干擾的影響,因此頻率穩定性較差,只能用於對頻率穩定性要求不高的場合。
綜上所述,因為本電路對精度沒有較高的要求,因此,我們選用由集成電路555與RC組成的多諧振盪器。
2)校時器的方案有如下兩種:
方案一:通常,校正時間的方法是:首先截斷正常的計數通路,然後再進行人工出觸發計數或將頻率較高的方波信號加到需要校正的計數單元的輸入端,校正好後,再轉入正常計時狀態即可。根據要求,數字鍾應具有分校正和時校正功能,因此,應截斷分個位和時個位的直接計數通路,並採用正常計時信號與校正信號可以隨時切換的電路接入其中。圖1所示為所設計的校時電路。
圖 1方案一校正電路圖
方案二:校準電路由基本RS觸發器和「與」門組成,基本RS觸發器的功能是產生單脈沖,主要作用是起防抖動作用。未撥動開關K時,「與非」門G2的一個輸入端接地,基本RS觸發器處於「1」狀態,這是數字鍾正常工作,「分」進位脈沖能進入「分」計數器。撥動開關K時,「與非」門G1的一個輸入端接地,於是基本RS觸發器轉為「0」狀態。秒狀態可以直接進入「分」計數器,而「分」進位脈沖被阻止進入,因而能較快地校準分計數器的計數值。校準後,將校正開關恢復原位,數字鍾繼續進行正常計時工作。
圖 2 方案二校正電路
通過比較可知,方案一和方案二相比,防抖動措施更好,更完備,但電路也更為復雜,成本也更高,通過比較選擇方案一,既能實現防抖動功能,做出事物也更經濟一些。
四.總體方案:
本電路是以555定時器組成多諧振盪器作為頻率發生器,多諧振盪器產生1000HZ的振盪波,經過分頻器分頻,分解成1HZ的脈沖波,隨後經過秒計數器,秒計時器是60進制計數器,當計數器計數到60時產生進位脈沖,到分計數器。分計數器也是60進制計數器,當分計數器計數到60時,再次產生更高一級的進位脈沖,脈沖送到時計數器,實現了分向時的進位。當需要進行校時時,打開對應的開關,進行對應位置上的校時,此時計數進位脈沖無效。
而計數器的工作是通過外接時鍾脈沖CP的作用下,秒的個位加法計數器開始記數,通過解碼器和數碼顯示管顯示數字即計數器。當經過10個脈沖信號後,秒個位計數器完成一次循環,秒十位計數器的CP與秒個位計數器的CP同步,秒個位計數器的Qcc使得秒十位的P和T端同時為1,從而秒十位開始計數,秒十位計數器工作1次,通過解碼器和數碼顯示管,秒十位數字加1。當經過60個脈沖信號,秒部分完成一個周期,分鍾個位計數器的CP通過秒十位計數器的Q2Q1與非得到脈沖,分鍾個位計數器工作一次,通過解碼器和數碼顯示管,分鍾的個位數字加1。分部分的工作方式與秒部分完全相同。當經過3600個脈沖信號,分鍾部分完成一個周期,小時個位計數器的CP通過分十位計數器的Q2Q1與非得到脈沖,小時個位計數器工作一次,通過解碼器和數碼顯示管,小時的個位數字加1。當小時個位部分完成一個周期,小時十位計數器的CP與小時個位計數器的CP同步, 小時個位計數器的Qcc使得小時十位的P和T端同時為1,從而小時十位開始計數,小時十位計數器工作1次,通過解碼器和數碼顯示管,小時的十位數字加1。當小時十位部分計數到2同時小時的個位部分計數到4,小時個位計數器的清零端和十位計數器的清零端通過小時個位計數器的Q2和小時十位計數器的Q1與非得到信號,小時部分清零,從而完成了1次24小時計時。
五.具體實現:
(1) 數字時鍾基本原理的邏輯框圖如下圖3所示:
由圖3我們可以看出,振盪器產生的信號經過分頻器作為產生秒脈沖,秒脈沖送入計數器,計數結果經過「時」、「分」、「秒」,解碼器,顯示器顯示時間。其中振盪器和分頻器組成標准秒脈沖信號發生器,由不同進制的計數器,解碼器和顯示電路組成計時系統。秒信號送入計數器進行計數,把累計的結果以「時」,「分」、「秒」的數字顯示出來。「時」顯示由二十四進制計數器,解碼器,顯示器構成;「分」、「秒」顯示分別由六十進制的計數器,解碼器,顯示器構成;校時電路實現對時,分的校準。
(2)數字鍾的原理圖如附一圖所示,其功能原理均與系統方框圖的一致。
六.各部分定性說明以及定量計算:
1.振盪器
秒發生電路---振盪器是計時器的核心,振盪器的穩定度和頻率的精確度決定了計時器的准確度。一般來說,振盪器的頻率越高,計時精度就越高,但耗電量將越大。所以,在設計電路時要根據需要而設計出最佳電路。
在此設計中,我採用的是精度不高的,由集成電路555與RC組成的多諧振盪器。其具體電路如下圖4所示:
圖4 振盪器電路圖
555定時器是一個模擬與數字混合型的集成電路。555定時器是一種應用極為廣泛的中規模集成電路。該電路使用靈活、方便,只需外接少量的阻容元件就可以構成單穩、多諧和施密特觸發器。因而廣泛用於信號的產生、變換、控制與檢測。
目前生產的定時器有雙極型和CMOS兩種類型,其型號分別有NE555(或5G555)和C7555等多種。它們的結構及工作原理基本相同。通常,雙極型定時器具有較大的驅動能力,而CMOS定時器具有低功耗、輸入阻抗高等優點。555定時器工作的電源電壓很寬,並可承受較大的負載電流。雙極型定時器電源電壓范圍為5~16V,最大負載電流可達200mA;CMOS定時器電源電壓范圍為3~18V,最大負載電流在4mA以下。
555的引腳圖如下圖5所示:
圖5
555的內部電路和功能如下圖6所示:
圖6
上面圖6 是555定時器內部組成框圖。它主要由兩個高精度電壓比較器A1、A2,一個RS觸發器,一個放電三極體和三個5KΩ電阻的分壓器而構成。
它的各個引腳功能如下:
1腳:外接電源負端VSS或接地,一般情況下接地。
8腳:外接電源VCC,雙極型時基電路VCC的范圍是4.5 ~ 16V,CMOS型時基電路VCC的范圍為3 ~ 18V。一般用5V。
3腳:輸出端Vo
2腳: 低觸發端
6腳:TH高觸發端
4腳: 是直接清零端。當 端接低電平,則時基電路不工作,此時不論 、TH處於何電平,時基電路輸出為「0」,該端不用時應接高電平。
5腳:VC為控制電壓端。若此端外接電壓,則可改變內部兩個比較器的基準電壓,當該端不用時,應將該端串入一隻0.01μF電容接地,以防引入干擾。
7腳:放電端。該端與放電管集電極相連,用做定時器時電容的放電。
在1腳接地,5腳未外接電壓,兩個比較器A1、A2基準電壓分別為
的情況下,其功能如下表:
555定時器的功能表
清零端
高觸發端TH 低觸發端
Qn+1 放電管T 功能
0
0 導通 直接清零
1
0 導通 置0
1
1 截止 置1
1
Qn 不變 保持
接通電源後,電容C1被充電,vC上升,當vC上升到大於2/3VCC時,觸發器被復位,放電管T導通,此時v0為低電平,電容C1通過R2和T放電,使vC下降。當vC下降到小於1/3VCC時,觸發器被置位,v0翻轉為高電平。電容器C1放電結束,所需的時間為 :
當C1放電結束時,T截止,VCC將通過R1、R2向電容器C1充電,vC由1/3VCC上升到2/3VCC所需的時為:
當vC上升到2/3VCC時,觸發器又被復位發生翻轉,如此周而復始,在輸出端就得到一個周期性的方波,其頻率為 :
本設計中,由電路圖可知R1、R2和C的值,然後再根據f的公式可以算出:其輸出的頻率為f=1KHz.
2.分頻器
分頻器的功能主要有兩個:一個是產生標准秒脈沖信號;二是提供功能擴展電路所需要的信號,如仿電台報時用的1000Hz的高音頻信號和500Hz的低音頻信號等。
本設計中,由於振盪器產生的信號頻率太高,要得到標準的秒信號,就需要對所得的信號進行分頻。這里所採用的分頻電路是由3個總規模計數器74LS90來構成的3級1/10分頻。
其電路圖如下圖7所示:
圖7 分頻器電路圖
74LS90的引腳圖及其功能圖如下圖所示:
74LS90引腳圖
74LS90 功能表
3.計數器
本設計所採用的是十進制計數器74SL160,根據時分秒各個部分的的不同功能,設計成不同進制的計數器。秒的個位,需要10進制計數器,十位需6進制計數器(計數到59時清零並進位),秒部分設計與分鍾的設計完全相同;時部分的設計為當時鍾計數到24時,使計數器的小時部分清零,從而實現整體循環計時的功能。
74LS160功能表和真值表如下表1和表2所示:
表1
輸入 輸出
(CR) ̅ (LD) ̅ CTT CTP CP D0 D1 D2 D3 Q0 Q1 Q2 Q3
0 × × × × × × × × 0 0 0 0
1 0 × × ↑ D0 D1 D2 D3 D0 D1 D2 D3
1 1 1 1 ↑ × × × × 計數
1 1 0 × × × × × × 觸發器保持,CO=0
1 1 × 0 × × × × × 保持
表2
74LS160的真值表
CLK Q
Q
Q
Q
0 0 0 0 0
1 0 0 0 1
2 0 0 1 0
3 0 0 1 1
4 0 1 0 0
5 0 1 0 1
6 0 1 1 0
7 0 1 1 1
8 1 0 0 0
9 1 0 0 1
10 0 0 0 0
74LS160的引腳介紹如下表3所示:
表3
74LS160邏輯符號 各引腳頓的名稱
D D D D
置數端
Q Q Q Q
輸出端
EP ET 工作狀態控制端
LD 預置數控制端
RD 非同步置零(復位)端
CO 進位輸出端
CLK 信號輸入端
計數部分:利用74LS160晶元和74LS00晶元組成的計數器,它們採用非同步連接,利用外接標准1Hz脈沖信號進行計數。
顯示部分: 將六片74LS160的Q0Q1Q2Q3腳分別接到實驗箱上的數碼顯示管上,根據脈沖的個數顯示時間。
秒信號經過計數器之後分別得到顯示電路,以便實現用數字顯示時、分、秒的要求,計時電路共分三部分:計秒、計分和計時。其中,計秒和計分都是60進制,而計時為24進制,可以採用十進制計數器74LS160實現24進制、60進制計數器。
(1)六十進制計數
由分頻器來的秒脈沖信號,首先送到「秒」計數器進行累加計數,秒計數器應完成一分鍾之內秒數目的累加,並達到60秒時產生一個進位信號,所以,選用2片74LS160和一片74LS00組成六十進制計數器,採用反饋歸零的方法來實現六十進制計數。其中,「秒」十位是六進制,「秒」個位是十進制。
秒部分具體設計如圖8所示:
圖8
秒的個位部分為逢十進一,十位部分為逢六進一,從而共同完成60進制計數器,當計數到59時清零並重新開始計數。如圖所示個位1腳接高電平,7腳、9腳及10腳接1,當7腳和10腳同時為1時計數器處於計數工作狀態。個位11腳和秒的十位的2腳相接,十位的9腳、10腳、7腳分別和個位的1腳相接。個位計數器由Q3Q2Q1Q0(0000)2增加到(1001)2時產生進位,從而實現10進制計數和進位功能,秒的十位在計數至0110時由與非門反饋清零實現6進制。
分鍾部分設計與秒完全相同。
(2)二十四進制計數器:
選用2片74LS160和一片74LS00組成24進制計數器,採用反饋歸零的方法來實現24進制計數。當十位為0010且個位為0100時使兩晶元非同步清零。
小時部分具體設計如圖9所示:
圖9
4.解碼器、顯示器
解碼是指把給定的代碼進行翻譯的過程。計數器採用的碼制不同,解碼電路也不同。74LS48驅動器是與8421BCD編碼計數器配合用的七段解碼驅動器。74LS48配有燈測試LT、動態滅燈輸入RBI,滅燈輸入/動態滅燈輸出BI/RBO,當LT=0時,74LS48出去全1。
本系統用七段發光二極體來顯示解碼器輸出的數字,顯示器有兩種:共陽極顯示器或共陰極顯示器。74LS48解碼器對應的顯示器是共陰極顯示器。
本實驗採用實驗箱中的74LS48解碼器和共陰極顯示器組成的顯示系統。
5.校時電路
數字種啟動後,每當數字鍾顯示與實際時間不符進,需要根據標准時間進行校時。校「秒」時,採用等待校時。校「分」、「時」的原理比較簡單,採用加速校時。
對校時電路的要求是 :
1)在小時校正時不影響分和秒的正常計數 。
2)在分校正時不影響秒和小時的正常計數 。
如圖10所示,當數字鍾走時出現誤差時,需要校正時間。校時電路實現對「時」「分」「秒」的校準。在電路中設有正常計時和校對位置。本實驗實現「時」「分」的校對。需要注意的是,校時電路是由與非門構成的組合邏輯電路,開關S1或S2為「0」或「1」時,可能會產生抖動,為防止這一情況的發生我們接入一個由RS觸發器組成的防抖動電路來控制。
校時電路圖 圖10
校時開關的功能表如下:
校時開關的功能表
S1 S2 功能
1 1 計數
0 1 校分
1 0 校時
6.整點報時電路
整點報時,只報時不報分。從59分50秒起,每隔2s發出一次信號,連續五次,最後一次結束時即達到正點。其原理圖如下所示:
圖11
電路圖如下圖12所示:
圖12
綜合以上多個電路,將其連接起來,就組成了一個具有時、分、秒計時功能,能夠手動校時、校分,並且整點報時的數字電子鍾。
七.實驗模擬:
在電子電路計算機模擬軟體Multisim中進行調試和模擬數字電子鍾,得到的模擬電路圖如附二圖所示。
由模擬電路實驗知道了當高頻信號經過分頻器後得到標準的秒脈沖信號,進入60進制的「秒」計時,「秒」的分位進入60進制的「分」計時,最後,由分的「時」進位進入24進制的「時」計時。再加上由門電路和開關構成的校時電路對電路的「時」,「分」進行校時,從而得到正確的時間的。
八.元器件清單
(1)74LS160( 6片) (2)74LS00(15片)
(3)數碼顯示器(6片) (4)74LS90(3片)
(5)74LS30(1片) (6)74LS04(1片)
(7)74LS02(1片) (8)555計時器(1片)
(9)可變電容(1個) (10)電容(2片)
(11)蜂鳴器(1個) (12)電阻(2個)
(13)數字電路實驗箱 (14)+5V電源若干
(15)導線,開關若干。
九.設計心得體會
在此次的數字鍾設計過程中,更進一步地熟悉了晶元的結構及掌握了各晶元的工作原理和其具體的使用方法。使我對已學過的電路、數電、模電等電子技術的知識有了更深一步的了解,鍛煉和培養了自己利用已學知識來分析和解決實際問題的能力。對自己以後的學習和工作有很大的幫助。
剛開始做這個設計的時候感覺自己什麼都不知道怎麼下手,腦子里比較浮躁和零亂。但通過一段時間的努力,通過重溫數電,模電等電子技術的書籍,還有通過查看相關的設計技術以及一些參考文獻,再加之在老師的指導和周圍同學的幫助下,使我對自己的本設計有了熟練的掌握。
在整個的設計過程中我充滿了渴望和用心。記得在精工實習的時候,也是用滿腔的熱情來完成各項實習任務,並在每項實習項目中都達到了優秀的成績。 所以,我相信自己的實際動手能力,並一向的加強自己在這方面的努力。在這次的電子技術設計中亦是如此,用自己的雙手和滿腔的熱情來完成各個環節,不斷的在圖書管查看相關資料和期刊文獻,特別在網路上也收收獲了很多新鮮的東西。這次設計更讓我熟悉了一些常用集成邏輯電路和其相應晶元的使用。
雖然,在本設計中所用的方案不是最好的,但我想其中的原理是最基本的;雖然其中可能出現誤差,不過在楊老師的答疑課上,這些問題還是基本解決了。
最後,我要衷心的感謝楊老師給了我一次實踐的機會和平時在學習上的莫大幫助,讓我更加深刻地了解和認識到了自己的優點和不足,通過這個課程設計我發現了我好多知識都不熟悉甚至有的東西我根本就不知道,這讓我感到了要學習的東西還有很多很多。因此使我更堅定了在以後的學習中要扎實好基礎,闊廣知識面。碰到的問題越讓人絕望,解決問題之後的喜悅程度就越高。作為工科類的學生,以後工作了難免要碰到許許多多的問題,不要絕望,堅持,直到看到勝利的曙光。
十.參考文獻
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毛期儉主編. 數字電路與邏輯設計實驗及應用. 北京: 人民郵電出版社.
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黃智偉主編. 電子電路計算機模擬設計與分析. 北京:電子工業出版社.
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李中發主編. 電子技術基礎課程設計. 武漢:華中理工大學出版社.
D. 數字邏輯課程設計!救命啊!!!求電路圖(用類似74161之類的晶元和觸發器)
呵呵。。。你不會就是我們學校的吧。。。表示懷疑啊。。我那時候的課程設計就是設計的時鍾哎。。。24小時顯示時分秒。。。不過那個都忘記的了,建議你到圖書館找一下這類的書,分類應該是數字電路的設計或應用之類的。。。上面就有類似的設計,我那時候就是參考書上來的,最後效果很好,是僅有的幾個得優之一。。。
E. 急求!!拉扎維模擬cmos集成電路設計課後習題答案 要中文的 word文檔的最好,pdf也行。
http://ishare.iask.sina.com.cn/f/14854472.html (第2章節_第一部分
http://ishare.iask.sina.com.cn/f/14854471.html (第2章節_第二部分
http://ishare.iask.sina.com.cn/f/14854473.html (第3章節
http://ishare.iask.sina.com.cn/f/14854474.html ( 第4章節
http://ishare.iask.sina.com.cn/f/14854475.html (第5章節
http://ishare.iask.sina.com.cn/f/14854488.html (第6章節
http://ishare.iask.sina.com.cn/f/14854489.html (第7章節
http://ishare.iask.sina.com.cn/f/14854490.html (第8章節
http://ishare.iask.sina.com.cn/f/14854491.html (第9章節
http://ishare.iask.sina.com.cn/f/14854492.html (第10章節
F. 麻煩發送一份模擬COMS集成電路設計課後習題答案 拉扎維的 急用,謝謝啦
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在裡面找,我也重發到這個郵箱了。
祝您學習生活愉快。
H. 集成電路工程的課程設置
基礎課:政治理論課、外語課、高等工程數學(含矩陣理論、隨機過程與排隊論、高等代數、應用泛函分析、隨機過程、數值分析、運籌學、泛函分析、組合數學等)、半導體器件物理等。
技術基礎課:固體電子學、電路優化設計、數字通訊、系統通信網路理論基礎、數字集成電路設計、模擬集成電路設計、集成電路CAD、微處理器結構及設計、系統晶元(SoC)與嵌入式系統設計、射頻集成電路、大規模集成電路測試方法學、微電子封裝技術、微機電系統(MEMS)、VLSI數字信號處理、集成電路製造工藝及設備、電子信息材料技術、現代管理學基礎等。
專業課:專業課程可由各培養點根據各自的培養方向和行業實際需要確定。
上述課程可定為學位課和非學位課。此外,還可以根據培養單位的情況和合作企業的要求進行增減。課程學習總學分不少於32學分。
I. 電子課程設計,LC179型三聲模擬聲報替集成電路買不到,可用什麼代替,謝謝
ISD1420,無需單片機控制,REC端連接一個按鍵常按下保持錄音,PLAY端低電平播放,畢業設計用過,使用很簡單,不需要單片機控制,連接一個麥克風,一個喇叭,連接按鍵就可以完成
J. 電子課程設計
數字電子鍾的設計(由數字IC構成)
一、設計目的
1. 熟悉集成電路的引腳安排。
2. 掌握各晶元的邏輯功能及使用方法。
3. 了解麵包板結構及其接線方法。
4. 了解數字鍾的組成及工作原理。
5. 熟悉數字鍾的設計與製作。
二、設計要求
1.設計指標
時間以24小時為一個周期;顯示時、分、秒;有校時功能,可以分別對時及分進行單獨校時,使其校正到標准時間;計時過程具有報時功能,當時間到達整點前5秒進行蜂鳴報時;為了保證計時的穩定及准確須由晶體振盪器提供表針時間基準信號。
2.設計要求
畫出電路原理圖(或模擬電路圖);元器件及參數選擇;電路模擬與調試;PCB文件生成與列印輸出。
3.製作要求 自行裝配和調試,並能發現問題和解決問題。
4.編寫設計報告 寫出設計與製作的全過程,附上有關資料和圖紙,有心得體會。
三、設計原理及其框圖
1.數字鍾的構成
數字鍾實際上是一個對標准頻率(1HZ)進行計數的計數電路。由於計數的起始時間不可能與標准時間(如北京時間)一致,故需要在電路上加一個校時電路,同時標準的1HZ時間信號必須做到准確穩定。通常使用石英晶體振盪器電路構成數字鍾。圖 3-1所示為數字鍾的一般構成框圖。圖3-1 數字鍾的組成框圖
⑴晶體振盪器電路
晶體振盪器電路給數字鍾提供一個頻率穩定準確的32768Hz的方波信號,可保證數字鍾的走時准確及穩定。不管是指針式的電子鍾還是數字顯示的電子鍾都使用了晶體振盪器電路。⑵分頻器電路
分頻器電路將32768Hz的高頻方波信號經32768( )次分頻後得到1Hz的方波信號供秒計數器進行計數。分頻器實際上也就是計數器。
⑶時間計數器電路
時間計數電路由秒個位和秒十位計數器、分個位和分十位計數器及時個位和時十位計數器電路構成,其中秒個位和秒十位計數器、分個位和分十位計數器為60進制計數器,而根據設計要求,時個位和時十位計數器為12進制計數器。
⑷解碼驅動電路
解碼驅動電路將計數器輸出的8421BCD碼轉換為數碼管需要的邏輯狀態,並且為保證數碼管正常工作提供足夠的工作電流。
⑸數碼管
數碼管通常有發光二極體(LED)數碼管和液晶(LCD)數碼管,本設計提供的為LED數碼管。
2.數字鍾的工作原理
1)晶體振盪器電路
晶體振盪器是構成數字式時鍾的核心,它保證了時鍾的走時准確及穩定。
圖3-2所示電路通過CMOS非門構成的輸出為方波的數字式晶體振盪電路,這個電路中,CMOS非門U1與晶體、電容和電阻構成晶體振盪器電路,U2實現整形功能,將振盪器輸出的近似於正弦波的波形轉換為較理想的方波。輸出反饋電 阻R1為非門提供偏置,使電路工作於放大區域,即非門的功能近似於一個高增益的反相放大器。電容C1、C2與晶體構成一個諧振型網路,完成對振盪頻率的控制功能,同時提供了一個180度相移,從而和非門構成一個正反饋網路,實現了振盪器的功能。由於晶體具有較高的頻率穩定性及准確性,從而保證了輸出頻率的穩定和准確。
晶體XTAL的頻率選為32768HZ。該元件專為數字鍾電路而設計,其頻率較低,有利於減少分頻器級數。
從有關手冊中,可查得C1、C2均為30pF。當要求頻率准確度和穩定度更高時,還可接入校正電容並採取溫度補償措施。
由於CMOS電路的輸入阻抗極高,因此反饋電阻R1可選為10MΩ。較高的反饋電阻有利於提高振盪頻率的穩定性。
非門電路可選74HC00。
圖3-2 COMS晶體振盪器
2)分頻器電路
通常,數字鍾的晶體振盪器輸出頻率較高,為了得到1Hz的秒信號輸入,需要對振盪器的輸出信號進行分頻。
通常實現分頻器的電路是計數器電路,一般採用多級2進制計數器來實現。例如,將32768Hz的振盪信號分頻為1HZ的分頻倍數為32768(215),即實現該分頻功能的計數器相當於15極2進制計數器。常用的2進制計數器有74HC393等。
本實驗中採用CD4060來構成分頻電路。CD4060在數字集成電路中可實現的分頻次數最高,而且CD4060還包含振盪電路所需的非門,使用更為方便。
CD4060計數為14級2進制計數器,可以將32768HZ的信號分頻為2HZ,其內部框圖如圖3-3所示,從圖中可以看出,CD4060的時鍾輸入端兩個串接的非門,因此可以直接實現振盪和分頻的功能。
圖3-3 CD4046內部框圖
3)時間計數單元
時間計數單元有時計數、分計數和秒計數等幾個部分。
時計數單元一般為12進制計數器計數器,其輸出為兩位8421BCD碼形式;分計數和秒計數單元為60進制計數器,其輸出也為8421BCD碼。
一般採用10進制計數器74HC390來實現時間計數單元的計數功能。為減少器件使用數量,可選74HC390,其內部邏輯框圖如圖2.3所示。該器件為雙2—5-10非同步計數器,並且每一計數器均提供一個非同步清零端(高電平有效)。
圖3-4 74HC390(1/2)內部邏輯框圖
秒個位計數單元為10進制計數器,無需進制轉換,只需將QA與CPB(下降沿有效)相連即可。CPA(下降沒效)與1HZ秒輸入信號相連,Q3可作為向上的進位信號與十位計數單元的CPA相連。
秒十位計數單元為6進制計數器,需要進制轉換。將10進制計數器轉換為6進制計數器的電路連接方法如圖3-5所示,其中Q2可作為向上的進位信號與分個位的計數單元的CPA相連。
圖3-5 10進制——6進制計數器轉換電路分個位和分十位計數單元電路結構分別與秒個位和秒十位計數單元完全相同,只不過分個位計數單元的Q3作為向上的進位信號應與分十位計數單元的CPA相連,分十位計數單元的Q2作為向上的進位信號應與時個位計數單元的CPA相連。
時個位計數單元電路結構仍與秒或個位計數單元相同,但是要求,整個時計數單元應為12進制計數器,不是10的整數倍,因此需將個位和十位計數單元合並為一個整體才能進行12進制轉換。利用1片74HC390實現12進制計數功能的電路如圖3-6所示。
另外,圖3-6所示電路中,尚余-2進制計數單元,正好可作為分頻器2HZ輸出信號轉化為1HZ信號之用。 圖3-6 12進制計數器電路
4)解碼驅動及顯示單元
計數器實現了對時間的累計以8421BCD碼形式輸出,選用顯示解碼電路將計數器的輸出數碼轉換為數碼顯示器件所需要的輸出邏輯和一定的電流,選用CD4511作為顯示解碼電路,選用LED數碼管作為顯示單元電路。
5)校時電源電路
當重新接通電源或走時出現誤差時都需要對時間進行校正。通常,校正時間的方法是:首先截斷正常的計數通路,然後再進行人工出觸發計數或將頻率較高的方波信號加到需要校正的計數單元的輸入端,校正好後,再轉入正常計時狀態即可。
根據要求,數字鍾應具有分校正和時校正功能,因此,應截斷分個位和時個位的直接計數通路,並採用正常計時信號與校正信號可以隨時切換的電路接入其中。圖3-7所示即為帶有基本RS觸發器的校時電路,
圖3-7 帶有消抖動電路的校正電路
6)整點報時電路
一般時鍾都應具備整點報時電路功能,即在時間出現整點前數秒內,數字鍾會自動報時,以示提醒。其作用方式是發出連續的或有節奏的音頻聲波,較復雜的也可以是實時語音提示。
根據要求,電路應在整點前10秒鍾內開始整點報時,即當時間在59分50秒到59分59秒期間時,報時電路報時控制信號。報時電路選74HC30,選蜂鳴器為電聲器件。
四、元器件
1.實驗中所需的器材:
5V電源。麵包板1塊。示波器。萬用表。鑷子1把。剪刀1把。網路線2米/人。
共陰八段數碼管6個。CD4511集成塊6塊。CD4060集成塊1塊。74HC390集成塊3塊。
74HC51集成塊1塊。74HC00集成塊5塊。74HC30集成塊1塊。10MΩ電阻5個。
500Ω電阻14個。30p電容2個。32.768k時鍾晶體1個。蜂鳴器。 詳情請訪問 http://www.51dz.com/index.asp?i=kjf888